高速采集存储系统

超高速采集板卡——数字输出选择

1.仪表促进了更快的ADC速度和更多的通道数与密度，设计者必须评估转换器的输出格式，以及基本的转换性能。2.主要的输出选项是CMOS(互补金属氧化物半导体)、LVDS(低压差分信令)，以及CML(电流模式逻辑)。3.要考虑的问题包括：功耗、瞬变、数据与时钟的变形，以及对噪声的抑制能力。4.对于布局的考虑也是转换输出选择中的一个方面，尤其当采用LVDS技术时。

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数据采集卡的位数是不是和采集数据多少有关呢？

ADC的位数是指垂直分辨率位数，位数越高，量化误差越小，测试动态越大，同时幅度测试精度越高。这是高分辨率的优势。采用14Bit的ADC，采集的每一个样点用二进制表示将有14位。

数据转换速率是指采样率，每秒钟采集多少个样点。

ADC工作分为两步：时间离散和幅度量化，前者对应采样，量化就是使用多少位数据去表示一个幅值，高速采集存储设备，因为量化间隔不可能无穷小，所以存在量化误差。

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如何同步多个ADC或高速数据采集卡

同步的关键元素：触发器和时钟是建立系统时间的外部信号。时钟信号设定了事情发生的频率，高速采集存储卡，当采集开始的时候，触发器就会告诉你。几个数字化的同步器的同步依赖于三个关键要素:

1.时钟频率必须与所有的数字化仪保持一致，并处于相对应的阶段。这需要一个外部的公共时钟引用。

2.必须有一个信号来确定每个数字化仪中记录数据的起始点。这是通过触发信号来完成的，它必须对所有的单元进行对齐。

3.时间戳记在每个数字化仪中的时间。这些计数器必须在所有的单元中进行操作。

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